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S5PC100的時(shí)鐘機(jī)制

時(shí)間：2016-12-12作者：華清遠(yuǎn)見

1. 時(shí)鐘域

S5PC100包含三個(gè)總線部件分,第一部分包括Cortex-A8,D0_bus和D0_bus的附加模塊。Cortex-A8只支持同步模式,以便Cortex-A8和D0_bus必須同步操作。第二部分包括D1_bus和D1_bus的附加模塊。后部分,D2域,是低功耗的音頻。

D0域高可以操作在166MHZ的時(shí)鐘頻率下時(shí)鐘,D1域高可以操作在133MHZ的時(shí)鐘頻率下(D1域有很多多媒體IPs可以工作在133MHZ下)。D2域高可以操作在80MHZ的時(shí)鐘頻率下。所有三個(gè)部分是通過異步橋進(jìn)行通信的。

下圖是時(shí)鐘域的分配圖：

2 時(shí)鐘源極其選擇

∗時(shí)鐘在S5C100由以下幾類劃分:
        ∗時(shí)鐘來至于引腳, i.e., XusbXTI, XXTI, XXTI27, and XrtcXTI
        ∗時(shí)鐘來至于時(shí)鐘管理單元(CMU), e.g., HCLKD0, HCLKD1, and etc
        ∗時(shí)鐘來至于USB OTG PHY(refer 7.8)
        ∗時(shí)鐘來至于 GPIO 引腳, e.g., XciPCLK, XpwmECLK, and etc

圖二

有圖可以看出:

3. 時(shí)鐘產(chǎn)生

圖2的方塊圖顯示了時(shí)鐘生成邏輯。一個(gè)外部的石英鐘是連接到振蕩放大器,鎖相環(huán)把一個(gè)低頻率的時(shí)鐘轉(zhuǎn)換成一個(gè)高頻的時(shí)鐘提供給S5PC100。時(shí)鐘發(fā)生器模塊有一個(gè)內(nèi)置的邏輯來穩(wěn)定時(shí)鐘頻率,因?yàn)樵诿總€(gè)系統(tǒng)復(fù)位后都需要一段時(shí)間來讓這個(gè)系統(tǒng)穩(wěn)定。

4.總線時(shí)鐘域?qū)?yīng)的每一個(gè)模塊

有圖可知: D0_bus,D1_bus,D2_bus分別給不同的模塊提供時(shí)鐘,這里我們重點(diǎn)關(guān)注D0_BUS和D1_BUS這兩個(gè).

5.CPU 和 BUS 時(shí)鐘

在 CPU和BUS之間,Cortex-A8只支持同步模式。 D0和D1是通過異步的方式進(jìn)行通信的。

下圖是D0_BUS和D1_BUS的功能圖:

下圖是D2_BUS的功能圖:

6. 寄存器描述

6.1 PLL Mask寄存器
系統(tǒng)控制器控制PLL,時(shí)鐘發(fā)生器,電源管理部分和其他依賴于系統(tǒng)的部分，本節(jié)描述如何使用系統(tǒng)的特殊的功能寄存器(SFR)控制這些模塊。

這個(gè)是時(shí)鐘屏蔽寄存器,系統(tǒng)一共有4個(gè)PLL,故有4個(gè)屏蔽寄存器,如果輸入頻率改變或頻分(乘法)值改變了,鎖相環(huán)需要鎖定一段時(shí)間。當(dāng)PLL鎖定時(shí),即使沒有方法來檢,但是PLL指定了一個(gè)屏蔽的周期去屏蔽PLL的輸出,屏蔽的周期長短取決于每一個(gè)時(shí)鐘源。在此期間,鎖相環(huán)輸出將被屏蔽了。這就是為什么要設(shè)置一個(gè)屏蔽時(shí)間。

注意: 在A/M/E/H中推薦的屏蔽時(shí)間是300微秒,PLL的屏蔽值基于輸入時(shí)鐘計(jì)數(shù)的。例如,當(dāng)輸入時(shí)鐘頻率是12MHZ時(shí),屏蔽時(shí)間是300微秒,PLL_MASKTIME將為3600(= 0xe10)。

6.2 PLL 控制寄存器